20xx年电大20xx电大电工电子技术形成性考核册答案内容摘要:

:图 3( a)和( b)所示电路均不能不失真地放大交流信号。 其中图( a)中缺少基极偏置,图( b)中缺少发射极电阻。 图 5为分压式偏置放大电路,图中有 4处错误,请指出。 图 5 解:( 1) C3 应接到三极管发射极对地端;( 2)发射极对地端需接 RE 与 C3 并联;( 3)三极管集电极应接电阻 RC;( 4)电源电压 UCC应为正电压。 说明图 6所示电路为何种运算电路。 已知: R1=12k, RF=18k,当输入电 压 uI= 时,试求输出电压值 uO。 UCC RL RB2 RB1 C3 C2 C1 • • • • • • • 186。 186。 186。 186。 186。 18 图 6 解: 该电路为反向比例运算电路。 uO=-。 图 7( a)所示运放具有理想特性,设两个输入电压波形如图 7( b)所士示。 试画出电压 u0的波形。 ( a) ( b) 图 7 解:图示电路为标准减法器,直接运用公式即可得所求: u0=RR ( ui2 ui1) = ui2 ui1 据此可画出输出波形如下图所示 t t Ui2 Ui1 1 0 1 1 0 1 U0 Ui2 Ui1 R R R R • • • 186。 186。 186。 + + ∞ t u0 1 0 1 19 图 8 所示为两级运放电路,已知 R1=RF1=10k,R2=R3=RF2=20k, uI1=1V和 uI2=,计算电路输出电压 uO。 说明该电路能够实现何种功能。 图 8 解; u0=,该电路为减法运算电路。 数字电路部分 一、单项选择题 数字电路内部的电路三极管电路器件,一般处于( C )工作状态,即数字开关状态,其输入、输出只有高、低两种电位。 A. 截止或放大 B. 导通或放大 C. 截止或导通 一个二进制表达式为: ()2=124+123+022+121+020+121+ 122, 其中 24项称为( B )。 A. 基数 B. 权 C. 系数 3. 异或运算表达式为 : F=AB =( C )。 A. AB+AB B. AB+AB C. AB+AB 4. 描述逻辑功能的方法是: ( A )。 可由用真值表、逻辑图、表达式三种方法中的任何一种 C. 只能用真值表、逻辑图两种方法中的任何一种 D. 只能用逻辑图、表达式两种方法中的任何一种 5. 对于 TTL 门电路, ( B ) 输出为高电位时,带负载的能力强。 F. 输出为低电位时,带负载的能力强。 G. 输出为高电位、低电位时,带负载的能力相同。 6. 基本 RS触发器,其动作要点是: ( C ) “ 1看 S” 、 “1 看 R” I.“ 1看 S” 、 “ 0看 R” J.“0 看 S” 、 “1 看 R” 7. D触发器功能: ( C ) 具有置位、复位、保持和翻转 四种功能 、复位、保持三种功能 、复位两种功能 20 8. 555 定时器电路在应用中,当输出为高电位时 :其 7 脚处于 ( A )工作状态 开路 二、简答题 ,应用反演律将一个原函数变为其反函数,需进行哪些“互换”。 答:三种互换:与运算( )和或运算( +)互换、逻辑常量 1与 0互换、原变量与反变量互换(对偶规则进行两种互换, 不需原、反变量互换)。 2. 对于或门、或非门,它们的多余输入端应当如何处理。 对于与门、与非门,它们的多余输入端又应当如何处理。 对于 CMOS 电路多余输入端是否不允许悬空。 答:对于或门、或非门电路,它们的多余输入端应当接低电位;与门、与非门,多余输入端应当接高电位。 (对于 TTL 电路输入端悬空相当于高电位) CMOS电路输入端不允许悬空。 3. 组合逻辑电路的逻辑功能和电路结构的特点是什么。 答:组合逻辑电路的特点是:从逻辑功能上看:输出只与当时输入的逻辑值有关,而与该时刻之前的输入及电路状态均无关,或称其没有 记忆功能。 从电路结构上看,构成组合逻辑电路的各门电路之间没有反馈环路。 4. 对组合逻辑电路的分析步骤是什么。 答:在逻辑图中,对每个门的输出端加以标注;写出每个门输出的逻辑函数表达式;将每个门输出的逻辑函数表达式进行迭代,并进行必要的化简;最后写出真值表,并说明该电路的用途。 5. 结合图 1电路图,简述其执行置位功能的过程。 图 1 答: 置位又称为置 1,其过程如下: 置位功能 :当 S=0、 R=1 时,置位端为有效低电位,使与非门 U1 输出高电位,实现置位功能,即 Q=1。 此时,与非门 U2 的 两输入为 R= Q=1,使输出 Q=0。 满足两输出为互补条件。 6. 主从型 JK 触发器,在 CP 上升沿的作用下,其动作有何特点。 答:主从型触发器,又称为电位触发型方式,其动作特点是:时钟 CP 上升沿到来前一刻瞬间, J、 K接收输入信号,并要求在 CP=1 期间,输入状态保持稳定。 时钟下降沿到来后产生输出。 21 7. 边沿型 JK 触发器,在 CP 脉冲信号的作用下,其动作有何特点。 (分为负边沿、正边沿两种情形) 答:负边沿型(下降沿触发型): CP下降沿到来的前一刻瞬间, J、 K接收输入; CP下降沿到来后产生输出。 正边沿型(上升沿触 发型): CP上升沿到来前一刻瞬间, J、 K 接收输入; CP 上升沿到来后产生输出。 JK 触发器的特性方程,并确定下述几种情形下的输出次态( Qn+ 1)、 说明触发器所对应的功能。 当 J=1 时,若 Qn=0时, 当 K=1 时,若 Qn=1时, 当 J=0、 K=0 时,初态为 Qn时, 当 J= K=1 时,初态为 Qn 时, 答: JK触发器的特性方程是: Qn+ 1=JQn +KQn 当 J=1 时,若 Qn=0,则 Qn+ 1;实现置位功能; ( JQn +KQn=1+0=1) 当 K=1 时,若 Qn=1,则 Qn+ 1= =0;实现复位功能 ; 当 J=0、 K=0 时,则 Qn+ 1=Qn;实现保持功能 ; 当 J= K=1 时,则 Qn+ 1=Qn;实现翻转功能。 三、 综合题 1. 一个三位二进制数码由高位至低位分别送至电路的三个输入端,要求三 位数码中有奇数个 1 时,电路输出为 1,否则为 0。 试画出逻辑图。 解:( 1)根据提出的逻辑功能要求,列出真值表如下表。 A B C F 0 0 0 0 1 1 1 1 0 0 1 1 0 0 1 1 0 1 0 1 0 1 0 1 0 1 1 0 1 0 0 1 ( 2)根据真值表列写出函数表达式 F= A B CCBACBACBA  = )()( ACCABCACAB  上式中 ACCA  = ACCA  = ))(( CACA  = CACA  所以 F= )()( CACABCACAB  =B⊕ A⊕ C ( 1) 画逻辑图 由表达式可画出逻辑图如下图所示,它由两个异或门构成。 22 2. 根据下图所示波形,利 用与非门画出实现其逻辑功能的逻辑图。 解 采用正逻辑,高电平为逻辑“ 1”,低电平为逻辑“ 0”。 根据波形列出真值表下表 A B C F 0 0 0 0 1 1 1 1 0 0 1 1 0 0 1 1 0 1 0 1 0 1 0 1 0 0 1 1 1 0 0 0 ,写出逻辑函数 FI、 F F的表达式,并指出其逻辑功能。 t t t t F C B A F C B A =1 =1 23 解 F1= F2= F3=AB+AB 其逻辑功能是实现两个一位二进制数的比较功能。 4. 8 线- 3 线优先编 码器 74148 逻辑框图、功能表如下图所示,分析其逻辑功能 逻辑图 功能表 ( 2) 其输入、输出的有效电位是什么。 ( 3) 若以 L 表示低电位, H 表示高电位, x 表示高电位或者低电位,则当输入为 01234567=xxxxxxL 时,输出为 A2A1A0 为何值。 相当于什么十进制数。 ( 4) 输出为 A2A1A0=LLH=110= (6)10,相当于十进制数 6 时,当输入01234567 为何值。 ( 1)答:根据功能表得知,其输入、输出均以低电位为有效电位。 ( 2)答: 01234567=xxxxxxL=0000001;输出 A2A1A0=LLL=111= (7)10,相 当于十进制数 7。 ( 3) 答: A2A1A0=LLH=110= (6)10,相当于十进制数 6 时,输入为01234567=xxxxxLH=0000010。 7 脚为无效高电位,反映出优先编码器功能。 24 74161 构成的计数电路如下图所示。 设计数器的初态为 0,即 QDQCQBQA=0000,( 1)绘出其计数状态 图,( 2)分析其计数长度是多少。 解: 设计数器的初态为 0,即 QDQCQBQA=0000,绘出其计数状态图如下 000000010010001101000101011001111000100110101011 由于计数器的循环计数状态共有 7 个,即计数长度为 7,是一个七进制加法计数器。 6. 下图为二进制加法计数器 74161 构成的计数电路,构成八进制计数电路。 ( 1)设计数器的初态为 0,即 QDQCQBQA=0000,绘出其计数状态图( 2)完成电路的正确连接。 解: 25 设计数器的初态为 0,即 QDQCQBQA=0000,绘出其计数状态图如下。 00000010010001101000101011001111000100110101011 正确的电路图,见下图所示。 下面是赠送的国际法小抄,可以编辑删除,不需要的朋友 26 15 年电大期末考试国 际经济法小抄(用心整理的精品小抄可以编辑) 名词解释或填空 ,是在组织上。
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