基于单片机at89c52智能密码锁设计毕业论文内容摘要:
RST引脚出现两个机器周期上高电平将使单片机复位。 WDT益出将使该引脚输出高电平,设置 SFR AUXR 的 DISRTO 位 4 (地址 8EH)可打开或关闭该功能。 DISRTO 位缺省为 RESET输出高电平打开状态。 PSEN:程序储存允许( PSEN)输出是外部程序存储器的读选通信号,当AT89S51由外部程序存储器取指令(或数据)时,每个机器周期两次 PSEN有效,即输出两个脉冲。 当访问外部数据存储器,高有两次有效的 PSEN信号。 EA/VPP:外部访问允许。 欲使 CPU公访问外部程序存储器(地址 0000H-FFFFH), EA端必须保持低电平(接地)。 需注意的是:如果加密位 LB1被编程,复位时内部会锁存 EA端状态。 如 EA端为高电平(接 VCC端), CPU则执行内部程序存储器中的指令。 Flash存储器编程时 ,该引脚加上+ 12V的编程电压 VPP。 XTAL1:振荡器反相放大器及内部时钟发生器的输入端。 AT89C52 内部芯片结构 特殊功能寄存器:特殊功能寄存器的片内空间分存如下图 32所示。 这些地址并没有全部占用,没有占用的地址不可使用,读这些地址将得到一个随意的数值。 而写这些地址单元将不能得到预期的结果。 中断寄存器:各中断允许控制位于 IE寄存器, 5个中断源的中断优先级控制位于 IP寄存器。 双时钟指针寄 存器:为方便地访问内部和外部数据存储器,提供了两个 16位数据指针寄存储器: PD0位于 SFR区块中的地址 82H、 83H和 DP1位于地址 84H、85H,当 SFR中的位 DPS=0时选择 DP0,而 DPS=1时选择 DP1。 在使用前初始化 DPS。 电源空闲标志:电源空闲标志( POF)在特殊功能寄存储器 SFR中 PCON的第 4位( ) ,电源打开时 POF置“ 1” ,它可由软件设置睡眠状态并不为复位所影响。 存储器结构: MCS51单片机内核采用程序存储器和数据存储器空间分开的结构,均具有 64KB外部程序和数据的寻址空 间。 程序存储器:如果 EA引脚接地( GND),全部程序均执行外部存储器。 在AT89C52,假如接至 VCC(电源+),程序首先执行从地址 0000H- 0FFFH( 4KB)内部程序存储器,再执行地址为 1000H- FFFFH( 60KB)的外部程序存储器。 数据存储器:在 AT89C52的具有 128字节的内部 RAM,这 128字节可利用直接或间接寻址方式访问,堆栈操作可利用间接寻址方式进行, 128字节均可设置为堆栈区空间。 [5] 5 看门狗定时器( WDT): WDT是为了解决 CPU程序运行时可能进入混乱或死循环而设置,它由一个 14bit计数器和看狗复位 SFR( WDTRST)构成。 外部复位时, WDT默认为关闭状态,要打开 WDT,必按顺序将 01H和 0E1H写到 WDTRST寄存器,当启动了 WDT,它会随晶体振荡器在每个机器周期计数,除硬件复位或 WDT溢出复位外没有其它方法关闭 WDT,当 WDT溢出,将使 RST引脚输出高电平的复位脉冲。 LCD1602 的介绍 液晶显示模块已作为很多电子产品的通过器件,如在计算器、万用表、电子表及很多家用电子产品中都可以看到,显示的主要是数字、专用符号和图形。 1602型 LCD 显示模块具有体积小,功耗低,显示内容丰富等特点。 1602 型 LCD 可以显示 2 行 16 个字符,有 8 位数据总线 D0D7 和 RS,R/W,EN 三个控制端口,工作电压为 5V,并且具有字符对比度调节和背光功能。 ( 1) 接口信号说明: ( 2) 1602 型 LCD 主要技术参数: 显示容量 :162 个字符 芯片工作电压 :— 工作电流 :() 模块最佳工作电压 : 字符尺寸 :(WH)mm ( 3) 1602 型 LCD 基本操作程序如下表所示: 第 四 章 系统硬件设计 本系统硬件部分由键 盘输入部分、复位部分、 LCD 显示部分、 LED 显示部分、晶振部分、开锁部分组成。 键盘输入模块 电路复位部分 6 LED 显示部分 本系统的 LED 显示部分主要由两个 LED 组成,其中 D1 代表开锁信号,当密码两次都正确时, D1 会闪亮一下; D2 代表密码错误,当三次输入错误时,D2 亮,且上锁。 晶振部分 AT89C52引脚 XTAL1和 XTAL2与晶体振荡器及电容 C C1按图 45所示方式。基于单片机at89c52智能密码锁设计毕业论文
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序设 计 16 单片机汇编语言源程序 20 显示及按键控制系统 35 LED 数码管 35 数据显示电路的设计 36 4 系统检测及分析 56 系统仿真 /硬件验证 56 系统的调试方法 56 系统的硬件验证 56 设计技巧分析 57 结 论 59 附录 A: FPGA 芯片引脚 60 附录 B:总体电路图 61 参考文献 62 致 谢 63 1. 系统设计 系统组成 以 CPLD/FPGA
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