开题报告及任务书-基于fpga串行通信控制器的设计内容摘要:
系: 电子信息科学系 学号: 20200506040 姓名 陈金河 一、 论文选题的目的和意义 近年来,随着电子技术的飞速发展,电子设计自动化成为了现代电子的核心, FPGA即现场可编程门阵列,它是在 PAL、 GAL、 EPLD 等可编程器件的基础上进一步发展的产物,是一种超大规模集成电路,具有对电路可重配置能力。 通常 FPGA 都有着上万次的重写次数,也就是说现在的硬件设计和软件设计一样灵活、方便。 FPGA 技术以空前的规模和速度渗透到各个行业,并成为当今电子设计领域应用中最为广泛的可编程逻辑器件之一,而串行通信又扮演着当今信息发展中 的重要角色,为了解决串行通信设备不易组网的问题,给出了串行通信控制器设计的方法,通过该控制器能够独立修改各个串口组网的要求,从而更好的实现串行通信,所以用 FPGA 研究串行通信控制器就显得很重要。 二、国内外关于该论题的研究现状和发展趋势 随着电子技术的发展, FPGA 得到广泛的应用。 从而 FPGA 实验设计就显得尤为重要,现有的很多通信,雷达和工业系统设备和外界信息交换是通过符合 RS232 标准串行口实现的,本文提出一种基于 FPGA 串行通信控制器的设计,串行通信是通过串行口来实现的,数据依次顺序的传输,近年 来,从技术发展来看,串行传输方式大有彻底取代并行传输方式的势头, USB 取代 IEEE 1284, SATA 取代 PATA, PCI Express 取代 PCI 等等。 串行方式为什么能够更胜一筹呢。 第一,并行传输技术遇到困境,随着处理器的速度越来越高,总线和接口也需要提高, 1981 年第一台 PC 中以 ISA 总线为标志的开放式体系结构,使用了 ISA 总线,数据总线为 8 位, 到了 286 时, ISA 的位宽提高到了 16位,到了 486 时代,同时出现了 PCI。开题报告及任务书-基于fpga串行通信控制器的设计
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被清 0,中断结束。 a)自动结束方式: 8259收到 后自动把中断在服务寄存器 ISRn位清 0(适用于单片 8259和中断无嵌套的情况)。 b)一般结束方式: 8086发命令清除中断在服务寄存器 ISR中的最高的置 1位清 0,结束中断(在全嵌套方式下使用)。 c)特殊结束方式:编程向 8259发出一条特殊中断结束命令,将中断在服务寄存器 ISR中指定位清 0(在非全嵌套方式下使用)。
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