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33qdpsk调制解调原理-中山大学信息科学与技术学院本科教育网站
入，查找表一般完成纯输入组合逻辑功能。 FPGA 5 内部寄存器结构相当灵活，可以配置为带同步 /异步复位或置位、时钟使能的触发器（ FF， Flip Flop），也可以配置成锁存器（ Latch）。 FPGA 一般依赖内部寄存器完成同步时序逻辑设计。 图 21 FPGA 的结构原理图 ]6[ （ 3） 嵌入式块 RAM 目前大多数 FPGA 都有内嵌的块 RAM（ Block RAM）。